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【简答题】
上传内容要求: 1、Verilog HDL语言程序实现,通过编译后的程序截图一张(需要有必要的文字说明哦); 2、对应的时序仿真图截图一张(对结果进行必要的文字说明)。 3、建议大家把自己所调试的程序打包上传哦,这样同学们可以相互分享了。 好吧,赶紧回复我的帖子按要求上传吧。
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知识点：
皮皮学刷刷变学霸
举一反三
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